在計(jì)算機(jī)體系結(jié)構(gòu)中，CPU 是對(duì)計(jì)算機(jī)的所有硬件資源（如存儲(chǔ)器、輸入輸出單元） 進(jìn)行控制調(diào)配、執(zhí)行通用運(yùn)算的核心硬件單元。CPU 是計(jì)算機(jī)的運(yùn)算和控制核心。計(jì)算機(jī)系統(tǒng)中所有軟件層的操作，終都將通過(guò)指令集映射為CPU的操作。

由于CPU訪問(wèn)內(nèi)存以得到指令或數(shù)據(jù)的時(shí)間要比執(zhí)行指令花費(fèi)的時(shí)間長(zhǎng)很多，因此在CPU內(nèi)部提供了一些用來(lái)保存關(guān)鍵變量、臨時(shí)數(shù)據(jù)等信息的通用寄存器。所以，CPU需要提供 一些特定的指令，使得可以從內(nèi)存中讀取數(shù)據(jù)存入寄存器以及可以將寄存器數(shù)據(jù)存入內(nèi)存。

CPU出現(xiàn)于大規(guī)模集成電路時(shí)代，處理器架構(gòu)設(shè)計(jì)的迭代更新以及集成電路工藝的不斷提升促使其不斷發(fā)展完善。從初專用于數(shù)學(xué)計(jì)算到廣泛應(yīng)用于通用計(jì)算，從4位到8位、16位、32位處理器，后到64位處理器，從各廠商互不兼容到不同指令集架構(gòu)規(guī)范的出現(xiàn)，CPU 自誕生以來(lái)一直在飛速發(fā)展。

為了改善性能，CPU已經(jīng)不是單條取指-->解了碼-->執(zhí)行的路線，而是分別為這3個(gè)過(guò)程分別提供獨(dú)立的取值單元，解了碼單元以及執(zhí)行單元。這樣就形成了流水線模式。

每核上的多線程CPU都共享該核的CPU資源。

假設(shè)每核CPU都只有一個(gè)"發(fā)動(dòng)機(jī)"資源，那么線程1這個(gè)虛擬CPU使用了這個(gè)"發(fā)動(dòng)機(jī)"后，線程2就沒(méi)法使用，只能等待。

所以，超線程技術(shù)的主要目的是為了增加流水線上更多個(gè)獨(dú)立的指令，這樣線程1和線程2在流水線上就盡量不會(huì)爭(zhēng)搶該核CPU資源。所以，超線程技術(shù)利用了superscalar(超標(biāo)量)架構(gòu)的優(yōu)點(diǎn)。

關(guān)于CPU上的高速緩存

1、高速的緩存是CPU的寄存器，它們和CPU的材料相同，靠近CPU或接近CPU，訪問(wèn)它們沒(méi)有時(shí)延(<1ns)。但容量很小，小于1kb。

2、寄存器之下，是CPU的高速緩存。分為L(zhǎng)1緩存、L2緩存、L3緩存，每層速度按數(shù)量級(jí)遞減、容量也越來(lái)越大。

3、每核心都有一個(gè)自己的L1緩存。L1緩存分兩種：L1指令緩存(L1-icache)和L1數(shù)據(jù)緩存(L1-dcache)。L1指令緩存用來(lái)存放已解了碼指令，L1數(shù)據(jù)緩存用來(lái)放訪問(wèn)非常頻繁的數(shù)據(jù)。

4、L2緩存用來(lái)存放近期使用過(guò)的內(nèi)存數(shù)據(jù)。更嚴(yán)格地說(shuō)，存放的是很可能將來(lái)會(huì)被CPU使用的數(shù)據(jù)。

5、多數(shù)多核CPU的各核都各自擁有一個(gè)L2緩存，但也有多核共享L2緩存的設(shè)計(jì)。無(wú)論如何，L1是各核私有的(但對(duì)某核內(nèi)的多線程是共享的)。