同步多個(gè)ADC或高速數(shù)據(jù)采集卡

時(shí)鐘信號(hào)：前面板上的時(shí)鐘參考信號(hào)或通過PXI 背板提供一個(gè)通用的參考時(shí)鐘。這個(gè)共同的時(shí)鐘參考保證了同步的長期穩(wěn)定性。

有三種情況:時(shí)鐘的同步是至關(guān)重要的:

1. 在單獨(dú)的通道上進(jìn)行數(shù)據(jù)的獲取，時(shí)間戳用于測量單個(gè)脈沖的時(shí)間，并在通道之間進(jìn)行比較。

2. 記錄非常長的記錄。(例如，時(shí)鐘頻率的1ppm偏差意味著在106的記錄結(jié)束時(shí)一個(gè)采樣點(diǎn)偏差)。

3. 連續(xù)的多個(gè)板流到PC上。如果不相鎖，數(shù)據(jù)速率會(huì)有所不同。

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高速數(shù)據(jù)采集處理存儲(chǔ)系統(tǒng)

高速數(shù)據(jù)采集處理存儲(chǔ)系統(tǒng)將目前較先進(jìn)的高速AD(1GS/S、500MS/S、180MS/S、125MS/S)，PCI-E總線，大規(guī)模磁盤陣列存儲(chǔ)及現(xiàn)代信號(hào)分析處理技術(shù)融合在一起，用于實(shí)時(shí)采集和記錄復(fù)雜現(xiàn)場環(huán)境中各種調(diào)制形式的中頻或射頻信號(hào)、高重頻雷達(dá)及超聲脈沖信號(hào)，將獲取的原始信號(hào)數(shù)據(jù)以高達(dá)1.4GB/s速率直接存儲(chǔ)到磁盤陣列中，另外數(shù)據(jù)可通過8GB/S的高速內(nèi)部總線提交給GUP高的性能處理器，實(shí)現(xiàn)信號(hào)高速實(shí)時(shí)處理及分析.系統(tǒng)專用的信號(hào)采集處理連續(xù)存儲(chǔ)管理軟件，實(shí)現(xiàn)各類參數(shù)控制，時(shí)域、頻域顯示、時(shí)頻分析，信號(hào)累加平均及各種專用信號(hào)處理算法、并將實(shí)時(shí)采集的數(shù)據(jù)高速寫入本地磁盤陣列中，實(shí)現(xiàn)數(shù)據(jù)采集、存儲(chǔ)、自動(dòng)分析與管理， 軟件可按不同系統(tǒng)要求定制。

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數(shù)據(jù)采集卡應(yīng)用于工業(yè)現(xiàn)場哪些地方

數(shù)據(jù)采集卡在應(yīng)用時(shí)，數(shù)據(jù)采集系統(tǒng)置于被監(jiān)控的設(shè)備處，通過傳感器對(duì)設(shè)備的電壓或者電流信號(hào)進(jìn)行采樣、保持，并送入AD轉(zhuǎn)換器變成數(shù)字信號(hào)，然后將該信號(hào)送到FIFO中。當(dāng)FIFO中存放的數(shù)據(jù)到了一定數(shù)目時(shí)，由ARM7從FIFO中讀出，然后通過ARM7的以太網(wǎng)接口或者RS232送給上位機(jī)?？紤]到要監(jiān)控的設(shè)備可能會(huì)很多，所以設(shè)計(jì)了多路采集通道，他們經(jīng)過模擬開關(guān)后再進(jìn)入AD轉(zhuǎn)換器。CPLD是整個(gè)系統(tǒng)的控制核心，他控制采集通道的切換、AD轉(zhuǎn)換器的啟停、轉(zhuǎn)換后的數(shù)據(jù)在FIFO中的存放地址發(fā)生器、產(chǎn)生中斷請(qǐng)求以通知ARM7讀取存放在FIFO中的數(shù)據(jù)等。 運(yùn)行時(shí)的數(shù)據(jù)并送給PC機(jī)，通過運(yùn)行在PC機(jī)上的特定軟件對(duì)這些數(shù)據(jù)進(jìn)行分析，以此判斷當(dāng)前運(yùn)行設(shè)備的狀況，進(jìn)而采取相應(yīng)措施。當(dāng)前常用的數(shù)據(jù)采集裝置，在其系統(tǒng)軟件設(shè)計(jì)中，多采用單任務(wù)順序機(jī)制。這樣就存在系統(tǒng)安全性差的問題。這對(duì)于穩(wěn)定性、實(shí)時(shí)性要求很高的數(shù)據(jù)采集裝置來說是不允許的，因此有必要引入嵌入式操作系統(tǒng)。

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高速數(shù)據(jù)采集卡應(yīng)用案例

高速數(shù)據(jù)采集方式和PCIe總線的高速數(shù)據(jù)采集卡應(yīng)是局放監(jiān)測系統(tǒng)在硬件上的發(fā)展趨勢，這種配置方式有利于局放信號(hào)的實(shí)時(shí)顯示與分析，從而有利于對(duì)局放的信號(hào)特點(diǎn)和機(jī)理作進(jìn)一步研究。

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